1. 跟前端工程師合作，優(yōu)化timing、area、power并完成timing分析；
2. 優(yōu)化布局布線并完成版圖的驗證 (RC extraction, ECO, DRC, LVS)；
3. 負責芯片尺寸優(yōu)化，power的IR drop分析；
4. 使用Prime Timing完成靜態(tài)時序分析，包括setup和hold。

1. 集成電路、計算機、電子工程等相關(guān)專業(yè)；
2. 了解DC、ICC2、Innovus、formality、PT、PTPX等EDA工具；
3. 熟悉csh、tcsh、Makefile、TCL、perl和python等語言；
4. 了解Synopsys/Cadence/Mentor后端工具和流程 (ICC2/ Innovous/Calibre)。

1. 跟前端工程師合作，優(yōu)化timing、area、power并完成timing分析；
2. 優(yōu)化布局布線并完成版圖的驗證 (RC extraction, ECO, DRC, LVS)；
3. 負責芯片尺寸優(yōu)化，power的IR drop分析；
4. 使用Prime Timing完成靜態(tài)時序分析，包括setup和hold。

1. 集成電路、計算機、電子工程等相關(guān)專業(yè)；
2. 了解DC、ICC2、Innovus、formality、PT、PTPX等EDA工具；
3. 熟悉csh、tcsh、Makefile、TCL、perl和python等語言；
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2. 優(yōu)化布局布線并完成版圖的驗證 (RC extraction, ECO, DRC, LVS)；
3. 負責芯片尺寸優(yōu)化，power的IR drop分析；
4. 使用Prime Timing完成靜態(tài)時序分析，包括setup和hold。

1. 集成電路、計算機、電子工程等相關(guān)專業(yè)；
2. 了解DC、ICC2、Innovus、formality、PT、PTPX等EDA工具；
3. 熟悉csh、tcsh、Makefile、TCL、perl和python等語言；
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2. 優(yōu)化布局布線并完成版圖的驗證 (RC extraction, ECO, DRC, LVS)；
3. 負責芯片尺寸優(yōu)化，power的IR drop分析；
4. 使用Prime Timing完成靜態(tài)時序分析，包括setup和hold。

1. 集成電路、計算機、電子工程等相關(guān)專業(yè)；
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2. 優(yōu)化布局布線并完成版圖的驗證 (RC extraction, ECO, DRC, LVS)；
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4. 使用Prime Timing完成靜態(tài)時序分析，包括setup和hold。

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2. 優(yōu)化布局布線并完成版圖的驗證 (RC extraction, ECO, DRC, LVS)；
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4. 使用Prime Timing完成靜態(tài)時序分析，包括setup和hold。

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2. 優(yōu)化布局布線并完成版圖的驗證 (RC extraction, ECO, DRC, LVS)；
3. 負責芯片尺寸優(yōu)化，power的IR drop分析；
4. 使用Prime Timing完成靜態(tài)時序分析，包括setup和hold。

1. 集成電路、計算機、電子工程等相關(guān)專業(yè)；
2. 了解DC、ICC2、Innovus、formality、PT、PTPX等EDA工具；
3. 熟悉csh、tcsh、Makefile、TCL、perl和python等語言；
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